數(shù)字信號處理的集成電路FPGA實(shí)現(xiàn)技術(shù)

第1章 概述
1.1 FPGA架構(gòu)及內(nèi)部資源
1.2 FPGA 小系統(tǒng)
1.3 FPGA設(shè)計(jì)流程與開發(fā)工具
第2章 FPGA設(shè)計(jì)基礎(chǔ)
2.1 FPGA設(shè)計(jì)思想與設(shè)計(jì)原則
2.2 狀態(tài)機(jī)的設(shè)計(jì)方法
2.3 IP核的使用
2.4 功能仿真與邏輯驗(yàn)證
第3章 FPGA設(shè)計(jì)進(jìn)階
3.1 FPGA的優(yōu)化技術(shù)
3.2 跨時鐘域數(shù)據(jù)傳輸
3.3 時序分析與時序約束
第4章 基礎(chǔ)應(yīng)用實(shí)例——高分辨率數(shù)字信號發(fā)生器設(shè)計(jì)
4.1 概述
4.2 DDS技術(shù)原理
4.3 DDS模塊的FPGA實(shí)現(xiàn)
4.4 基于QuartusⅡ的固定頻率正弦波信號發(fā)生器仿真與驗(yàn)證
4.5 頻率可調(diào)的正弦信號發(fā)生器Verilog語言實(shí)例
4.6 有相位截?cái)嗟母叻直媛收倚盘柊l(fā)生器Verilog語言實(shí)例
第5章 工程應(yīng)用實(shí)例——高細(xì)分步進(jìn)電機(jī)驅(qū)動器基礎(chǔ)設(shè)計(jì)
5.1 步進(jìn)電機(jī)控制原理及硬件總體方案
5.2 基于FPGA的步進(jìn)電機(jī)細(xì)分控制邏輯設(shè)計(jì)
5.3 步進(jìn)電機(jī)細(xì)分控制的調(diào)試步驟
第6章 高速電路應(yīng)用實(shí)例——光纖通信控制器設(shè)計(jì)
6.1 光纖通信原理及系統(tǒng)總體架構(gòu)
6.2 光纖通信控制器的FPGA邏輯設(shè)計(jì)
6.3 系統(tǒng)仿真與驗(yàn)證
第7章 數(shù)字信號處理應(yīng)用實(shí)例——數(shù)字濾波器設(shè)計(jì)
7.1 數(shù)字濾波算法的原理
7.2 數(shù)字濾波器的FPGA實(shí)現(xiàn)方法
7.3 基于Vivado的FIR濾波器設(shè)計(jì)例程
第8章 SoC的構(gòu)建——基于ZYNQ的DDS發(fā)生器
8.1 概述
8.2 基于SoC的DDS發(fā)生器總體方案
8.3 基于SoC的DDS發(fā)生器設(shè)計(jì)
參考文獻(xiàn)