微型計(jì)算機(jī)原理與結(jié)構(gòu)（第3版）

第1章 二進(jìn)制數(shù)與計(jì)算機(jī)
1.1序言
1.2二進(jìn)制數(shù)
1.2.1表示法
1.2.2計(jì)算規(guī)則
1.2.3二進(jìn)制數(shù)與十進(jìn)制數(shù)的轉(zhuǎn)換
1.2.4八進(jìn)制數(shù)和十六進(jìn)制數(shù)
1.3計(jì)算機(jī)組成
1.3.1概述
1.3.2內(nèi)存儲(chǔ)器
1.3.3運(yùn)算器
1.3.4控制器
1.3.5輸入/輸出設(shè)備
習(xí)題
第2章 數(shù)字電路基礎(chǔ)
2.1邏輯量的基本運(yùn)算
2.2邏輯電路的實(shí)現(xiàn)
2.2.1晶體管
2.2.2邏輯門(mén)電路
2.3邏輯代數(shù)
2.3.1概述
2.3.2基本公式
2.3.3邏輯表達(dá)式化簡(jiǎn)
2.4常用數(shù)字電路
2.4.1傳送門(mén)
2.4.2加法器
2.4.3多路選擇器
2.4.4譯碼器292.4.5優(yōu)先權(quán)編碼器
2.4.6觸發(fā)器與寄存器
〖2〗〖3〗〖4〗習(xí)題
第3章 機(jī)器數(shù)與編碼
3.1機(jī)器數(shù)
3.1.1字和小數(shù)點(diǎn)
3.1.2有符號(hào)整數(shù)表示法
3.1.3負(fù)數(shù)補(bǔ)碼的真值
3.1.4補(bǔ)碼加減運(yùn)算
3.1.5整數(shù)的大小比較與移碼
3.2計(jì)算機(jī)中常用數(shù)據(jù)類(lèi)型
3.2.1整數(shù)
3.2.2實(shí)數(shù)
3.3二進(jìn)制編碼
3.3.1十進(jìn)制數(shù)字的二進(jìn)制編碼
3.3.2ASCII碼
習(xí)題
第4章 模型計(jì)算機(jī)
4.1基本結(jié)構(gòu)
4.2存儲(chǔ)空間與堆棧
4.3CPU組成
4.3.1算術(shù)邏輯運(yùn)算單元
4.3.2標(biāo)志寄存器
4.3.3寄存器組
4.3.4其他專(zhuān)用寄存器
4.4指令系統(tǒng)
4.4.1尋址方式
4.4.2傳送類(lèi)指令
4.4.3操作類(lèi)指令
4.4.4程序控制類(lèi)指令
習(xí)題
第5章 匯編語(yǔ)言程序設(shè)計(jì)基礎(chǔ)
5.1概述
5.2模型計(jì)算機(jī)匯編語(yǔ)言
5.2.1常數(shù)
5.2.2符號(hào)名
5.2.3匯編語(yǔ)言語(yǔ)句
5.2.4表達(dá)式
5.2.5偽指令
5.2.6匯編語(yǔ)言程序舉例
5.3程序設(shè)計(jì)基本方法
5.3.1順序程序設(shè)計(jì)
5.3.2分支程序設(shè)計(jì)
5.3.3循環(huán)程序設(shè)計(jì)
5.3.4子程序設(shè)計(jì)
習(xí)題
第6章 內(nèi)存儲(chǔ)器
6.1概述
6.2存儲(chǔ)芯片工作原理
6.2.1只讀存儲(chǔ)器ROM
6.2.2靜態(tài)隨機(jī)存儲(chǔ)器SRAM
*6.2.3動(dòng)態(tài)隨機(jī)存儲(chǔ)器DRAM
6.3存儲(chǔ)器電路
6.3.1存儲(chǔ)芯片的連接
6.3.2內(nèi)存構(gòu)成舉例
習(xí)題
第7章 中央處理器
7.1電路組成
7.1.1概述
7.1.2功能電路
7.2機(jī)器指令
7.3控制原理
7.3.1時(shí)鐘與微操作
7.3.2控制器組成及工作過(guò)程
7.3.3微指令與微操作信號(hào)
7.3.4微程序控制器
7.4指令流程
習(xí)題
第8章 輸入/輸出技術(shù)
8.1基本概念
8.1.1I/O接口
8.1.2I/O端口編址
8.2I/O傳送方式
8.2.1直接傳送
8.2.2查詢(xún)傳送
8.2.3中斷傳送
8.2.4DMA傳送
8.3程序中斷技術(shù)
8.3.1概述
8.3.2中斷源
8.3.3確定中斷源
8.3.4中斷響應(yīng)
8.3.5多級(jí)中斷
8.3.6模型機(jī)中斷系統(tǒng)
8.4數(shù)據(jù)通信基本概念
8.4.1數(shù)據(jù)通信系統(tǒng)
8.4.2數(shù)據(jù)傳送方式
8.4.3串行傳送的核心電路
8.4.4傳輸同步技術(shù)
8.4.5通信模式
8.4.6數(shù)據(jù)傳輸速率
8.5模型機(jī)中斷技術(shù)實(shí)現(xiàn)
8.5.1CPU中斷控制邏輯
8.5.2中斷響應(yīng)流程
8.6模型機(jī)DMA技術(shù)實(shí)現(xiàn)
8.6.1總線(xiàn)共享控制
8.6.2DMA控制器
8.6.3DMAC功能電路與控制邏輯
習(xí)題
第9章 通用接口應(yīng)用
9.1Intel 8255通用并行接口
9.1.1結(jié)構(gòu)組成
9.1.2控制字
9.1.3接口電路結(jié)構(gòu)
9.1.4應(yīng)用舉例
9.2Intel 8253 通用定時(shí)計(jì)數(shù)器接口
9.2.1結(jié)構(gòu)組成
9.2.2控制字
9.2.3通道的工作方式
9.2.4應(yīng)用舉例
9.3Intel 8251通用串行接口
9.3.1結(jié)構(gòu)組成
9.3.2控制字
9.3.3應(yīng)用舉例
9.4模數(shù)轉(zhuǎn)換接口
9.4.1ADC 0809模數(shù)轉(zhuǎn)換器接口
9.4.2DAC 0832數(shù)模轉(zhuǎn)換器接口
9.4.3應(yīng)用舉例
習(xí)題
第10章 個(gè)人計(jì)算機(jī)體系結(jié)構(gòu)
10.1概述
10.2PC設(shè)備管理技術(shù)
10.2.1即插即用
10.2.2電源管理
10.3總線(xiàn)
10.3.1并行總線(xiàn)
10.3.2串行總線(xiàn)
10.4內(nèi)存儲(chǔ)器系統(tǒng)
10.4.1動(dòng)態(tài)存儲(chǔ)器
10.4.2高速緩沖存儲(chǔ)器Cache
10.5常用標(biāo)準(zhǔn)接口
10.5.1并行接口
10.5.2串行接口
10.5.3USB
10.6PC結(jié)構(gòu)特點(diǎn)
10.6.1雙橋結(jié)構(gòu)
10.6.2內(nèi)置DRAM控制器結(jié)構(gòu)
10.6.3內(nèi)置北橋結(jié)構(gòu)
10.6.4PC中斷系統(tǒng)
10.7BIOS簡(jiǎn)介
10.7.1概述
10.7.2系統(tǒng)參數(shù)設(shè)置
習(xí)題
第11章 微處理器
11.1Intel 80486微處理器
11.1.1存儲(chǔ)空間
11.1.2處理器結(jié)構(gòu)
11.1.3尋址方式
11.1.4存儲(chǔ)分段的約定
11.1.5操作數(shù)的大小
11.1.6指令系統(tǒng)簡(jiǎn)介
11.1.7浮點(diǎn)運(yùn)算單元簡(jiǎn)介
11.1.8I/O空間
11.1.9中斷系統(tǒng)
11.1.10任務(wù)
11.2現(xiàn)代微處理器結(jié)構(gòu)
11.2.1指令流水線(xiàn)
11.2.2CISC和RISC
11.2.3先行控制技術(shù)
11.2.4超流水線(xiàn)與超標(biāo)量
11.2.5Pentium微處理器簡(jiǎn)介
11.2.6超線(xiàn)程與多核處理器
11.3CPU主要性能指標(biāo)
11.4新一代64位微處理器簡(jiǎn)介
習(xí)題
第12章 外部設(shè)備
12.1硬盤(pán)
12.1.1磁盤(pán)信息組織
12.1.2分區(qū)與格式化
12.1.3硬盤(pán)驅(qū)動(dòng)器結(jié)構(gòu)
12.1.4硬盤(pán)技術(shù)指標(biāo)與接口
12.2顯示系統(tǒng)
12.2.1CRT顯示器
12.2.2LCD顯示器
12.2.3顯示控制電路
12.2.4技術(shù)指標(biāo)與接口標(biāo)準(zhǔn)
12.3鍵盤(pán)
12.4鼠標(biāo)器
習(xí)題
附錄A 邏輯符號(hào)標(biāo)準(zhǔn)對(duì)照表
附錄B ASCII 碼表
附錄C 模型計(jì)算機(jī)指令系統(tǒng)表
附錄D 模型計(jì)算機(jī)指令周期表
附錄E Intel 16位空間常用指令表
參考文獻(xiàn)
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