TMS320*281*DSP原理與應用

第1章 緒論
1.1 TMS320F281x系列DSP的性能1
1.2 TMS320F281x系列DSP的結構3
1.3 TMS320F281x系列DSP的引腳分布4
1.4 信號說明7
1.5 TMS320C280x簡介16
第2章 CPU內(nèi)核結構及存儲器映射
2.1 CPU結構19
2.2 CPU寄存器20
2.2.1 累加器（ACC，AH，AL）22
2.2.2 被乘數(shù)寄存器（XT）22
2.2.3 乘積寄存器（P，PH和PL）23
2.2.4 數(shù)據(jù)頁指針（DP）23
2.2.5 堆棧指針（SP）24
2.2.6 輔助寄存器（XAR0～XAR7，AR0～AR7）24
2.2.7 程序計數(shù)器（PC）25
2.2.8 返回程序寄存器（RPC）25
2.2.9 中斷控制寄存器（IFR，IER，DBGIER）25
2.2.10 狀態(tài)寄存器（ST0，ST1）25
2.3 程序流43
2.3.1 中斷43
2.3.2 分支、調(diào)用和返回43
2.3.3 單個指令的重復執(zhí)行43
2.3.4 指令流水線43
2.4 乘法操作44
2.4.1 16位×16位乘法44
2.4.2 32位×32位乘法44
2.5 移位操作45
2.6 CPU中斷與復位49
2.6.1 CPU中斷概述49
2.6.2 CPU中斷向量和優(yōu)先級49
2.6.3 可屏蔽中斷51
2.6.4 可屏蔽中斷的標準操作54
2.6.5 非屏蔽中斷56
2.6.6 非法指令陷阱59
2.6.7 硬件復位（RS）59
2.7 流水線60
2.7.1 指令流水線61
2.7.2 可視流水線活動63
2.7.3 流水線活動的凍結65
2.7.4 流水線保護66
2.7.5 避免無流水線保護操作68
2.8 存儲器映射70
2.8.1 Flash存儲器（僅F281x）75
2.8.2 M0和M1 SARAM76
2.8.3 L0，L1和H0 SARAM76
2.8.4 Boot ROM76
2.8.5 安全76
第3章 TMS320X281x DSP的片內(nèi)外設
3.1 系統(tǒng)控制和外設中斷77
3.1.1 Flash和OTP存儲器77
3.1.2 代碼安全模塊77
3.1.3 時鐘80
3.1.4 通用I/O端口(GPIO)93
3.1.5 外設寄存器幀及EALLOW保護寄存器101
3.1.6 外設中斷擴展（PIE）102
3.2 系統(tǒng)外部接口（XINTF）119
3.2.1 總體功能描述119
3.2.2 XINTF配置122
3.2.3 前導、有效和結束三個階段等待狀態(tài)的配置125
3.2.4 XINTF寄存器126
3.2.5 外部DMA支持134
3.3 模/數(shù)轉換器（ADC）135
3.3.1 特點135
3.3.2 自動排序器的工作原理138
3.3.3 非中斷自動排序模式143
3.3.4 ADC時鐘的預標定148
3.3.5 ADC的供電模式和上電順序148
3.3.6 排序器覆蓋功能149
3.3.7 ADC控制寄存器150
3.3.8 最大轉換通道寄存器（ADCMAXCONV）156
3.3.9 自動排序狀態(tài)寄存器（ADCASEQSR）157
3.3.10 ADC狀態(tài)和標志寄存器（ADCST）158
3.3.11 ADC輸入通道選擇排序控制寄存器160
3.3.12 ADC轉換結果緩沖寄存器（ADCRESULTn）160
3.3.13 F2810，F(xiàn)2811和F2812內(nèi)部ADC的校正161
3.4 事件管理器167
3.4.1 概述168
3.4.2 通用定時器171
3.4.3 全比較單元182
3.4.4 PWM電路184
3.4.5 PWM波形的產(chǎn)生188
3.4.6 捕獲單元192
3.4.7 正交編碼器脈沖QEP電路194
3.4.8 EV中斷196
3.4.9 事件管理器的寄存器198
3.5 串行外設接口（SPI）224
3.5.1 增強型SPI模塊簡介224
3.5.2 操作介紹228
3.5.3 SPI中斷230
3.5.4 SPI FIFO介紹234
3.5.5 SPI控制寄存器236
3.5.6 SPI樣例波形246
3.6 串行通信接口250
3.6.1 增強型SCI模塊概述250
3.6.2 SCI模塊的結構252
3.6.3 SCI模塊寄存器概述263
3.6.4 SCI通信控制寄存器（SCICCR）264
3.6.5 SCI控制寄存器1（SCICTL1）265
3.6.6 SCI波特率選擇寄存器（SCIHBAUD，SCILBAUD）267
3.6.7 SCI控制寄存器2（SCICTL2）268
3.6.8 SCI接收器狀態(tài)寄存器（SCIRXST）269
3.6.9 接收器數(shù)據(jù)緩沖寄存器（SCIRXEMU和SCIRXBUF）271
3.6.10 SCI發(fā)送數(shù)據(jù)緩沖寄存器（SCITXBUF）272
3.6.11 SCI FIFO寄存器（SCIFFTX， SCIFFRX和 SCIFFCT）272
3.6.12 優(yōu)先級控制寄存器（SCIPRI）276
3.7 增強型CAN控制器模塊276
3.7.1 CAN簡介276
3.7.2 CAN的網(wǎng)絡和模塊278
3.7.3 eCAN控制器簡介279
3.7.4 消息對象282
3.7.5 消息郵箱283
3.7.6 eCAN的寄存器288
3.7.7 eCAN模塊的初始化過程和模塊的配置程序314
3.8 多通道緩沖串口327
3.8.1 McBSP模塊的功能和結構總覽327
3.8.2 McBSP模塊的操作328
3.8.3 多通道選擇模式334
3.8.4 接收器和發(fā)送器配置338
3.8.5 McBSP初始化流程339
3.8.6 McBSP的FIFO和中斷339
3.8.7 McBSP的其他寄存器345
3.9 Boot ROM359
3.9.1 Boot ROM總覽359
3.9.2 CPU向量表361
3.9.3 引導加載程序361
第4章 TMS320C28x DSP的尋址方式和指令系統(tǒng)
4.1 尋址方式374
4.1.1 尋址方式概述374
4.1.2 尋址方式選擇位375
4.1.3 匯編器/編譯器對AMODE位的追蹤377
4.1.4 各尋址方式的具體說明377
4.1.5 32位操作的定位384
4.2 C28x匯編語言簡介384
第5章 TMS320C28x與TMS320LF240x內(nèi)核的比較
5.1 從C2xLP到C28x內(nèi)核結構的變化385
5.1.1 C28x內(nèi)核相對于C2xLP的一些增強特性385
5.1.2 寄存器的變化386
5.1.3 數(shù)據(jù)頁（DP）指針387
5.1.4 狀態(tài)寄存器的變化389
5.1.5 CPU寄存器復位時的默認值390
5.2 C2xLP和C28x存儲器映射的區(qū)別392
第6章 TMS320X281x DSP的程序編寫和調(diào)試
6.1 DSP集成開發(fā)環(huán)境CCS394
6.1.1 CCS中的工程394
6.1.2 CCS的界面組成395
6.2 TMS320X281x DSP的軟件開發(fā)流程396
6.2.1 CCS集成開發(fā)環(huán)境的設置397
6.2.2 CCS集成開發(fā)環(huán)境的應用399
6.2.3 通用擴展語言（GEL）406
6.3 DSP/BIOS開發(fā)工具介紹407
第7章 實驗系統(tǒng)及實驗例程
7.1 實驗系統(tǒng)硬件介紹411
7.1.1 eZdspTM F2812簡介411
7.1.2 eZdspTM F2812使用411
7.1.3 TMS320F2812 重要電氣參數(shù)417
7.2 應用實驗例程421
7.2.1 實驗例程中的文件421
7.2.2 實驗程序的主要代碼425
附錄A 匯編指令集453
附錄B eZdspTM F2812原理圖468
參考文獻472