數(shù)字邏輯

1 引論
1.1 數(shù)字電路與數(shù)字系統(tǒng)
1.2 計(jì)算機(jī)簡(jiǎn)介
習(xí)題1
2 數(shù)字電路基礎(chǔ)
2.1 數(shù)制和碼
2.1.1 常用數(shù)制
2.1.2 數(shù)制轉(zhuǎn)換
2.1.3 二進(jìn)制數(shù)的算術(shù)運(yùn)算
2.1.4 定點(diǎn)制和浮點(diǎn)制
2.1.5 常用BCD碼與ASCH碼
2.2 邏輯代數(shù)基礎(chǔ)
2.2.1 邏輯變量和基本邏輯運(yùn)算
2.2.2 邏輯代數(shù)的基本規(guī)則和定理
2.2.3 邏輯函數(shù)的表示方法及轉(zhuǎn)換
2.2.4 邏輯函數(shù)的化簡(jiǎn)
習(xí)題2
3 邏輯門(mén)電路
3.1 分立元件邏輯門(mén)電路
3.1.1 二極管“與門(mén)”電路
3.1.2 二極管“或門(mén)”電路
3.1.3 “非門(mén)”電路（反相器）
3.2 TTL集成電路門(mén)
3.2.1 TTL與非門(mén)
3.2.2 集電極開(kāi)路門(mén)（OC門(mén)）
3.2.3 三態(tài)門(mén)（TS門(mén)）
3.2.4 TTL集成電路系列簡(jiǎn)介
3.3 CMOS門(mén)電路，
3.3.1 CMOS反相器
3.3.2 CMOS傳輸門(mén)
3.3.3 CMOS集成系列簡(jiǎn)介
3.4 集成門(mén)電路中使用中應(yīng)注意的幾個(gè)問(wèn)題
3.4.1 TTL邏輯電路的使用：
3.4.2 CMOS電路的操作保護(hù)措施
3.4.3 CMOS與TTL電路接口
習(xí)題3
4 組合邏輯電路
4.1 概述
4.2 組合邏輯電路的分析和設(shè)計(jì)方法
4.2.1 組合邏輯電路的分析方法
4.2.2 組合邏輯電路的設(shè)計(jì)方法
4.3 常用組合邏輯電路模塊
4.3.1 加法器
4.3.2 數(shù)據(jù)選擇器
4.3.3 數(shù)值比較器
4.3.4 編碼器
4.3.5 譯碼器
4.4 組合邏輯電路中的險(xiǎn)象競(jìng)爭(zhēng)
4.4.1 產(chǎn)生險(xiǎn)象的原因
4.4.2 險(xiǎn)象競(jìng)爭(zhēng)的判斷
4.4.3 險(xiǎn)象競(jìng)爭(zhēng)的消除方法
習(xí)題4
5 時(shí)序邏輯電路
5.1 概述
5.2 觸發(fā)器
5.2.1 基本RS觸發(fā)器
5.2.2 觸發(fā)器的邏輯功能分類(lèi)及邏輯轉(zhuǎn)換
5.2.3 觸發(fā)器的觸發(fā)方式
5.2.4 觸發(fā)器中其余端的處理
5.2.5 觸發(fā)器的脈沖工作特性及主要參數(shù)
5.3 時(shí)序邏輯電路的分析方法
5.4 計(jì)數(shù)器
5.4.1 同步計(jì)數(shù)器
5.4.2 異步計(jì)數(shù)器
5.4.8 行波計(jì)數(shù)器
5.4.4 集成計(jì)數(shù)器及應(yīng)用
5.5 寄存器
5.5.1 數(shù)據(jù)寄存器
5.5.2 移位寄存器
5.6 脈沖分配器
5.6.1 計(jì)數(shù)器和譯碼器組成的脈沖分配器
5.6.2 環(huán)形計(jì)數(shù)器作脈沖分配器
5.7 同步時(shí)序邏輯電路的設(shè)計(jì)
習(xí)題5
6 半導(dǎo)體存儲(chǔ)器與可編程邏輯器件
7 脈沖波形的產(chǎn)生與變換
8 D/A和A/D轉(zhuǎn)換器
9 數(shù)字系統(tǒng)設(shè)計(jì)
附錄 半導(dǎo)體器件的開(kāi)關(guān)特性
參考文獻(xiàn)