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內(nèi)容簡介

　　本書按照“器件—軟件—設(shè)計語言”的順序介紹數(shù)字系統(tǒng)設(shè)計的方法、CPLD/FPGA器件、典型的EDA設(shè)計軟件和VerilogHDL硬件描述語言，力求涵蓋數(shù)字系統(tǒng)開發(fā)涉及的主要技術(shù)，并在內(nèi)容上進行取舍，做了精心的編排。本書以具體的實例，詳細介紹用QuartusII、MAX+plusII軟件進行原理圖設(shè)計和文本設(shè)計開發(fā)的過程，對SynplifyPro/Synplify、ModelSim等專用開發(fā)工具的使用與相互接口也做了介紹。VerilogHDL數(shù)字設(shè)計是本書的重點，以可綜合的設(shè)計為重點，同時對仿真和模擬也做了深入闡述，討論了設(shè)計方法和設(shè)計優(yōu)化的問題，以大量經(jīng)過驗證的數(shù)字設(shè)計實例為依據(jù)，全面系統(tǒng)地闡述了VerilogHDL硬件設(shè)計開發(fā)的方法與技巧。本書突出的特點是：著眼于實用性，緊密聯(lián)系教學和科研實際，實例豐富。全書概念清晰，語言流暢，可讀性強。書中加入了大量的圖和表，以增強表述的效果。本書可作為電子工程、通信工程、儀器儀表、數(shù)字信號處理等專業(yè)本科生和研究生的教學用書，也可供從事電路設(shè)計和系統(tǒng)開發(fā)的工程技術(shù)人員閱讀參考。

作者簡介

暫缺《數(shù)字系統(tǒng)設(shè)計與Verilog HDL/EDA工具應(yīng)用叢書（第2版）》作者簡介

圖書目錄

第1章 EDA技術(shù)與數(shù)字系統(tǒng)設(shè)計
  內(nèi)容提要
  1.1 引言
  1.2 EDA技巧及其發(fā)展
  1.3 數(shù)字系統(tǒng)的設(shè)計技術(shù)
  1.4 數(shù)字系統(tǒng)的實現(xiàn)方式
  1.5 數(shù)字系統(tǒng)的設(shè)計輸入方式
  1.6 數(shù)字系統(tǒng)設(shè)計的流程
  1.7 常用的EDA設(shè)計工具
  習題
第2章 CPLD/FPGA的結(jié)構(gòu)與配置
  內(nèi)容提要
  2.1 概述
  2.2 PLD的分類
  2.3 PLD的基本結(jié)構(gòu)
  2.4 CPLD的結(jié)構(gòu)與特點
  2.5 FPGA的結(jié)構(gòu)與特點
  2.6 在系統(tǒng)編程與邊界掃描測試技術(shù)
  2.7 CPLD/FPGA器件產(chǎn)品概述
  2.8 PLD器件的發(fā)展趨勢
  習題
第3章原理圖設(shè)計輸入方式
  內(nèi)容提要
  3.1 原理圖設(shè)計的流程
  3.2 Quartus Ⅱ原理圖設(shè)計
  3.3 MAX+plus Ⅱ原理圖設(shè)計
  3.4 基于LPM宏單元庫的設(shè)計
  習題
第4章基于硬件描述語言的設(shè)計
  內(nèi)容提要
  4.1 基于HDL文本輸入的設(shè)計流程
  4.2 Quartus Ⅱ文本設(shè)計舉例
  4.3 MAX+plus Ⅱ文本設(shè)計舉例
  4.4 Synplify pro文本設(shè)計舉例
  4.5 Synplify文本設(shè)計舉例
  4.6 ModelSim仿真舉例
  4.7 ispLEVER文本設(shè)計舉例
  習題
第5章 Verilog HDl數(shù)字設(shè)計初步
……
第6章 Verilog HDl行為語句
第7章 Verilog HDl數(shù)字設(shè)計的層次與風格
第8章仿真
第9章 Verilog HDl數(shù)字電路設(shè)計實踐
第10章設(shè)計方法與設(shè)計優(yōu)化
第11章數(shù)字系統(tǒng)設(shè)計開發(fā)實例
第12章實驗與設(shè)計
附錄
參考文獻